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形式等效性检查

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形式等效性检查[1](英语:formal equivalence checking)是电子设计自动化的一个步骤,通常是在集成电路设计中,通过一些数学方法(如二元决策图布尔可满足性问题),来对不同电路之间进行形式验证,比较它们在行为上是否等效。

参考文献

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